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[VHDL/FPGA/Verilog] FPGA-connect4

FPGA图像处理加上AI算法，在物理环境上玩四通。
FPGA image processing plus AI algorithm to play connect four on a physical environment. (2020-09-08, Tcl, 1189KB, 下载0次)

http://www.pudn.com/Download/item/id/1599547321201173.html

[VHDL/FPGA/Verilog] Time-Reflex-Measurement-in-VHDL

该代码用于编程一个Basys3 FPGA板来玩一个基于人体反射的游戏，以点亮7段显示器。
The code to program a Basys3 FPGA board to play a game based on human reflex to a 7-segment display lighting up. (2023-03-31, Tcl, 159KB, 下载0次)

http://www.pudn.com/Download/item/id/1680234301444077.html
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